自強課程

課程名稱
(首開全線上)【入門】FPGA系統設計入門 (自備NB) 熱烈招生中 全線上
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上過學員力推課程及講師!!
一年僅此一班~ 報名至12/18截止,要統計人數及寄送板材,逾時不收
FPGA系統設計入門班培訓課程主要幫助學員盡快掌握 CPLD/FPGA 的開發流程和設計方法,以工程實踐爲例,循序漸進的學習FPGA的開發環境,開發流程以及硬體電路設計等知識。
 課程代碼:
13C070
 上課時間:
2024/12/28(六) 1/4(六) 1/11(六) 1/18(六) 1/19(日)9:00~16:00共30小時 
 上課時數:
30 小時
 上課地點:
線上課程/開班前會發googlemeet 連結
 課程費用:
20000元 (符合超值優惠價格者需送出報名表後,系統發出報名成功回函確認金額。)
 超值優惠:
  • VIP企業會員價:VIP企業會員可享優惠價格 (按我)
  • 會員優惠價: 會員於開課前七天完成報名繳費者可享會員優惠價 19800 元
  • 會員紅利折抵:本課程歡迎使用紅利折抵,最高可使用 100 點
 課程目標:
本課程以實作為主、以業界主流FPGA為核心,學員可以掌握HDL Verilog硬體描述語言的初步開發能力,教導學員從基礎學習,並且解決FPGA産品開發過程中的常見問題,每次課程都配有相關實戰訓練,每次實作訓練題目都可以FPGA硬件平台上進行下載驗證。教導學員從基礎學習,透過實作學員可以更好的理解課堂知識,迅速提高實踐水平。
 修課條件:
電子資訊類專業的大學生和研究生, 具數位邏輯基本觀念之FPGA系統的軟體和硬體開發工程師, 電子産品設計愛好者
 課程大綱:
1. FPGA 設計技術簡介及邏輯設計技術展望
2. FPGA 元件及架構介紹
3. FPGA設計流程開發工具
4. HDL硬體描述語言(Verilog)語法介紹
5. HDL 設計基本概念
6. HDL 描述組合邏輯(Combinatorial Logic)設計
7. HDL 描述序向邏輯(Sequential Logic)設計
8. 如何透過模擬及建立測試平台(testbench)來驗證設計 FPGA系統設計入門實作關鍵電路的設計
9. FPGA 組合邏輯基本輸出入(開關、按鍵與LED電路)
10. FPGA序向邏輯基本輸出入(開關、按鍵與LED電路)
11. 電路常用的計數器(Count), 及 移位暫存器(shift register)
12. 按鍵( Button)控制
13. 閃爍LED控制
14. 七段顯示器實習, 介紹多個七段顯示器的方法



 課程師資:
業界師資
  主辦單位:
財團法人自強工業科學基金會
  注意事項
  • 清華大學學生優惠方案:清華大學學生可享課程最低優惠價─VIP企業會員優惠價,完成報名後須來電告知修改費用(使用本優惠價須於報名同時檢附在學中有效的清華大學學生證,且不得開立抬頭「國立清華大學」以外的三聯式公司發票)。
  • 若遇不可預測之突發因素,基金會保有相關課程調整、取消及講師之變動權。
  • 無紙化環境,輕鬆達到減碳救地球,即日起16小時以上課程結業證書或未達16小時課程上課證明皆以電子方式提供。
  • 使用VIP廠商優惠之學員,上課當日報到時須查核該公司識別證(相關證明資料)。
  • 會員紅利折抵限以原價或會員優惠價再折抵,其他方案不適用。
  • 課前請詳閱簡章之課程內容或利用課程諮詢電話。
  • 課程嚴禁旁聽,亦不可攜眷參與。
  • 優惠方案擇一使用。
  • 課程查詢或相關作業時程,請洽以下聯絡窗口。
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